数据信号接口基于FPGA的ADSP-TS101扩展USB接口设计

基于FPGA的ADSP-TS101扩展USB接口设计

时间:2011年11月21日
Link口协议的一大特点就是在收发数据时可以选择是否需要校验位VERE比特,VERE的启用或关闭可以通过ADSP-TS101中的寄存器来设置,也可以通过FPGA模块中的Verein信号置高或置低来设置。该设 英特尔嵌入式架构英特尔凌动 未来百亿市场的掘金利器深圳企业中科院深圳先进院携企培育高新技术产业明丽半导体奖项银雨半导体:三驾齐驱 驶入电子十大评选快车道超声波子程序测距仪嵌入式超声波测距仪的设计方案厦门稀土公司厦门钨业钨稀并进 抓紧扩充稀土LED荧光粉研究称LED背光应用需求量2013年将达高峰iPad 2存储器由三星、海力士供应错误功能流程SpringSoft推出新版CERTITUDE功能验证品管系统会员年收入合约芯片制造协会FOA向所有会员开放团购
Link口协议的一大特点就是在收发数据时可以选择是否需要校验位VERE比特,VERE的启用或关闭可以通过ADSP-TS101中的寄存器来设置,也可以通过FPGA模块中的Verein信号置高或置低来设置。该设计在FPGA中设置VERE信号的启用或关闭。当VERE启用后,FPGA模块中的输出信号Rx_Vere_Bad用于表征最后接收的128 b数据是否正确。由于使用VERE有两个好处,一是能保证数据的完整性;二是能减小在两个时钟不严格一致的系统中传输数据时产生数据重叠的可能性。因而在设计中采用了带数据校验的传输方式。3 USB传输设计

  在上传传输时,采用异步自动输入方式。EZ-USB FX2芯片FIFO异步写时序如图8所示。根据此时序,在本设计中,FPGA输出的USB_Data信号提供给USB的FD数据线,FPGA输出的USB_SLWR提供给USB的SLWR,USB端便能在SLWR的下降沿把数据线FD中的数据写入到FX2芯片FIFO中,并由USB传送给主机。  4 结语  本文重点对DSP扩展USB接口的数据上行通道的硬件设计进行了详细论述。本系统经测试验证,通过该扩展USB接口,配合定制的上位机软件,DSP数据上传PC机的速率平均达到8 MB/s以上,连接可靠稳定,满足对DSP变量实时监测的数据率需求,同时可通过此接口完成程序的加载与烧写功能。仅需一台带USB接口的PC机,就能完成弹载DSP系统的实时测试与在线程序加载,简捷、通用、方便,具有显著的工程实用价值。
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